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現在開催中の特別開催コース一覧

コース名 概要
NEW!(無料)
はじめてのパーシャル・リコンフィグレーション 〜インテル® Arria® 10 FPGA 〜
<オンラインセミナー>
FPGA の正常な動作を保証するためには、適正な動作環境下で適切に設定されたタイミング制約を守る必要があります。本セミナーでは、タイミング制約の生成方法や不具合が発生しにくい回路構成を示すとともに、不具合発生時のデバッグ手順を4つのチェックポイントを交えてご紹介します。
NEW!(無料)
コンパイルし直したら FPGA が動作しない!そんな時チェックすべき 4つのポイント
<オンラインセミナー>
インテル FPGA に PCI Express を実装する場合のデザインフローとデバッグフローを紹介いたします。本セミナー受講により、PCI Express の実装の仕組みが理解できるため、不具合が発生しデバッグをする際も、より速やかに問題を解決することができるようになります。また、PCI Express でのリンクアップできない現象についてのアプローチ方法についてレクチャを行います。
NEW!(無料)
インテル提供の無料ディープラーニング推論環境「OpenVINO  ツールキット」のご紹介
<オンラインセミナー>
インテルから無料で使用可能な推論環境 「OpenVINO™ ツールキット」がリリースされました。本セミナーでは「OpenVINO™ ツールキット」の紹介はもちろんのこと、アルティマで取り扱いのある OpenVINO™ ツールキット対応のアクセラレータ (IEI社製) も合わせてご紹介いたします。

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マクニカ オリジナル ワークショップ

マクニカグループで開催しているワークショップのご紹介です。


コース名 概要
NEW!(無料)
インテル® HLS 入門編 トライアル
このセミナーでは、インテル® HLS コンパイラーを使用してインテル® FPGA 用の IP コンポーネントを合成、検証する方法をハンズオン付きで学ぶことができます。
(無料)
Quartus®  Prime 入門編 トライアル
Quartus Prime を触ってみたい!試してみたい!概要を知りたい!
そんなユーザ向けのトライアル(入門)コースです。全体フローからポイントとなる操作をピックアップして、簡単な演習を実施しながら解説していきます。
(無料)
Nios®  II 入門編 トライアル
ソフトコアCPU Nios II の導入を検討している方を対象としたセミナーです。
Nios II の特徴、開発環境等を説明し、基本となる設計手法を評価ボード並びに統合開発環境を実際にご使用いただき、具体的に学習していただきます。
(無料)
SoC スタートアップ・トライアル
本セミナーでは、初めて インテル SoC 開発を ご検討のお客様向けに、インテル SoC の開発フローをご紹介するとともに、今話題の超低価格 Cyclone® V SoC 評価環境 DE0-nano-SoC / Atlas SoC で、 Quartus® Prime /Qsys 及び インテル SoC FPGA エンベデッド・デザイン・スイート を用いて、実際の開発フローを 体感・習得する ハンズオン・セミナーです。
(無料)
カスタムマイコン設計トライアル
〜 MAX® 10 FPGA を使った組込み設計を体感! 〜
本セミナーは、ソフトウェアエンジニアでもわかる、FPGA 初心者のための組込機器における MAX 10 FPGA の活用法をご紹介いたします。弊社が開発した Odyssey MAX 10 FPGA Eval Kit や MAX 10 FPGA 評価キットを使ってハンズオン形式で開発やアプリケーション例を体感・習得することができます。

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過去に開催したセミナー・トレーニング一覧

過去に開催したコースです。同じコースを再度開催する予定はございませんが、今後も類似の新規コースを開催しますので、ご興味がある方はメールマガジンにご登録され、最新情報をチェックしてください。

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コース名

Cyclone V FPGA 基礎設計トレーニング
アルテラ SoC FPGA イントロダクション・セミナー
非同期クロック間転送解析セミナー
FPGA を使った安全設計 セミナー
PADS ・ HyperLynx による SI解析・回路図・基板設計ワークショップ
Qsys システム・インテグレーション・ワークショップ
はじめての ModelSim-Altera トライアル
28nm FPGA テクノロジ & デザイン セミナ
HyperLynx による伝送線路シミュレーション(SI 解析)/熱解析手法セミナ
驚きの開発工数 1/10 ! Nios II を用いたGUI設計手法 セミナ
Linux for Nios II セミナ
FPGAで実現するマルチプロセッサ システム構築セミナ