SoC はじめてガイド HPS-FPGA 間のアクセス方法

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設計 FPGA/CPLD/ASIC Intel

インテル® SoC FPGA は、ARM® Cortex®-A9 MPCore™ プロセッサと FPGA とがデバイス内でバス接続されています。デバイス内で接続されているため、プロセッサと FPGA 間の転送レート不足の解消や、基板上の実装面積の縮小が期待されます。

この資料では、インテル® Arria® V SoC FPGA や Cyclone® V SoC FPGA における、Hard Processor System (HPS) とFPGA 間のアクセス方法を説明します。

＜対応バージョン＞

Quartus® Prime v17.0

＜内容＞

1. はじめに

2. HPS-FPGA 間のインタフェース

3. アドレス・マップ

4. ハードウェアの設定

　4-1. HPS コンポーネントの設定（AXI Bridges / FPGA-と HPS SDRAM Interface）

　4-2. 他のコンポーネントとの接続

　4-3. インタフェースの初期化

5. ソフトウェアからのアクセス

　5-1. アドレスの考え方

　5-2. システム・ヘッダ・ファイル

6. 参考情報