アルティマ技術データベース

2019年3月15日 最新 FAQ(11件) New

デバイスに関する FAQ

Arria®10 FPGA 3件
MAX®10 FPGA 2件
Enpirion®1件

開発ソフトウェア に関する FAQ

Quartus®1件
TimeQuest 1件
Intel®SDK for OpenCL 2件
ModelSim®-Intel®FPGA Edition 1件

IP に関する FAQ

トランシーバ 1件

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2018年12月27日 最新資料(1件) New

インテル MAX 10 FPGA On-Chip Flash を使用するときの注意点

2018年12月19日 最新資料(1件)

タイミング& インプリメンテーションデザイン・デバッグガイドライン

2018年11月28日 最新資料(1件)

VirtualBox と CentOS 6 による仮想マシン環境の構築
Nios II 向け各種 Flash コントローラの紹介
Nios II UART の活用術 DMA との結合でソフトウェア負荷軽減

2018年9月21日 最新資料(2件)

Nios II I2C スレーブの活用術 〜address stealing の使用方法〜
Nios II I2C マスターの活用術 〜Avalon-ST インターフェースによる通信〜

2018年9月14日 最新資料(1件)

HLS はじめてガイド - 簡易チュートリアル


おすすめ資料

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トラブルシュータ Active Serial Configuration 編
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はじめてみよう!VHDL <演習問題つき>
2018年11月19日
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2018年11月19日
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2018年11月28日
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2018年9月21日
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2018年9月14日
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2018年9月6日
Nios II HAL API を使用したソフトウェア・サンプル集 「Modular Scatter-Gather DMA Core」
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2017年3月6日
Quartus - サポート・デバイス・ファミリ 対応表 ver.17.1
2017年3月1日
Quartus - サポート Windows OS 対応表 ver.17.1
2017年7月7日
HDL Designer Series - 簡易チュートリアル 〜DesignChecker 編〜
2016年3月9日
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2017年7月7日
HDL Designer Series - 簡易チュートリアル 〜グラフィカルビュー変換編〜
2017年8月10日
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DSP Builder - アドバンスト・ブロックセットのデザイン例一覧 ver.16.0
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2017年3月1日
Quartus Prime ガイド - Design Space Explorer II の使い方 ver.16
2016年10月24日
Quartus Prime ガイド - Qsys システム統合ツールの使い方 ver.16.0
2016年10月24日
Nios II はじめてガイド - Nios II SBT とBSP Editorオプション設定 v16.0
2016年10月24日
OpenCL 基礎演習(Atlas-SoC ボード編) v15.1
2016年9月15日
DSP Builder - アドバンスト・ブロックセットのデザイン例一覧 ver.13.1
2016年6月21日
SoCはじめてガイド - DS-5によるベアメタルアプリケーションデバッグ
2016年6月7日
ModelSim-Altera - RTL シミュレーションの方法
2016年6月7日
Quartus Prime - プログラミング・ファイルの生成と変換(Convert Programming Files) ver.15.1
2016年5月18日
はじめてみよう!Verilog-HDL <演習問題つき>
2016年5月18日
はじめてみよう!VHDL <演習問題つき>

2019年3月15日 最新 FAQ(11件) New

Q55: Arria® 10 の温度センサ IP(Altera Temperature Sensor)はどのようなタイミングで温度を測定しますか?
Q56: Arria® 10 で Multiply Accumulate を実装するには Native Floating point DSPと Floating Point IP のどちらを使えばよいですか?
Q57: ALTERA_FP_FUNCTIONS IP では、Arria® 10 の場合 "Enable Hardware Floating Point" を ON/OFF することでどのように影響しますか?
Q119: MAX® 10 で Remote System Upgrade を行う場合、コンフィグレーション・イメージを2面 (Factory と Application)用意しておき Application Image を書き換えすることしかできないのでしょうか?シングル・イメージでのアップデートを行う事は可能でしょうか?
Q120: MAX® 10 のコンフィグレーション中の I/O ピンは Weak-PullUp ON 状態ですか?それともQuartPrime設定等でユーザーが任意設定(Hi-ZやWeakPullUpON)が可能ですか?
Q28: EN5339QI のデータシートに MTBF の記載がありますが、試験条件を教えてください。
Q148: Quartus® Prime Pro Edition v18.1.2 (Update 2) で Stratix® 10 MX デバイスのコンパイルを実行するとライセンスエラーとなります。
Q19: Quartus® Prime Standard Edition ver.17.1 を使用しています。Arria® 10 GX で External PLL で LVDS を構成したとき、detive_pll_clocks で制約した loadena の clock について、タイミングレポートを見ると PLL の設定と異なる値になります。
Q63: OpenCL™ の レポートに記載される Thread Capacity とはなんですか?
Q64: OpenCL™ で、int8 や FP16 などの半精度浮動小数点数の計算を FPGA で実行することは可能ですか?
Q29: ModelSim®-Intel® FPGA Edition を使った Nativelink シミュレーション環境での検証時に DCFIFO のローディングでエラーが発生します。

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